allegro学习之给元件封装添加与丝印层一样的assembly 层
2017-03-20 16:11
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在使用allegro16.6修改元器件封装时,我遇到的是元件封装没有画assembly layer。
解决方法:
1.用PCB editor打开.dra文件;
2.点击菜单栏Add->line;
3.在options中class选择package ,subclass选择assembly_top,width中可以设置你想要的画线宽度;
4.沿着丝印层内部画即可;
5.添加器位号,菜单栏中layout->labels->RefDes,在合适的位置点击一下,输入你想要的编号即可(比如U*,后一个应为*,代表不确定)。
注意:如果出现不能紧挨着丝印层画线的情况,可能是grid设置过大,可以在菜单栏选择Step->grid,如下图所示,将格点设置为0.01mm(我用的mm制,可在Step->design parameter中修改)即可。
解决方法:
1.用PCB editor打开.dra文件;
2.点击菜单栏Add->line;
3.在options中class选择package ,subclass选择assembly_top,width中可以设置你想要的画线宽度;
4.沿着丝印层内部画即可;
5.添加器位号,菜单栏中layout->labels->RefDes,在合适的位置点击一下,输入你想要的编号即可(比如U*,后一个应为*,代表不确定)。
注意:如果出现不能紧挨着丝印层画线的情况,可能是grid设置过大,可以在菜单栏选择Step->grid,如下图所示,将格点设置为0.01mm(我用的mm制,可在Step->design parameter中修改)即可。
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